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Low Power 10-b 250 Msample/s CMOS Cascaded Folding and Interpolating A/D Converter 저전력 10-b 250 Msample/s CMOS 캐스케이드 폴딩 및 보간 A/D 변환기

Zhi-Yuan CUI, Yong-Gao JIN, Nam-Soo KIM, Ho-Yong CHOI

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요약 :

본 논문에서는 폴딩 및 보간 10-b ADC의 새로운 폴딩 증폭기를 소개합니다. 증폭기는 전류 미러와 차동 스테이지로 구성됩니다. 계단식 차동 쌍에서는 하나의 전류 소스만 활용되므로 전력 소비가 크게 줄어듭니다. 폴딩 회로에서는 전류 분할 기술을 사용하여 보간을 구현합니다. 10-b 폴딩 신호의 증폭기 실험은 단일 폴리 0.35금속 10μm CMOS 프로세스에 통합되었습니다. 225-b 폴딩 ADC의 시뮬레이션에서는 샘플링 속도 250 Msample/s 및 전원 공급 장치 3.3 V에서 전력 소비가 XNUMX mW임을 보여줍니다. 예비 실험에서는 전류 조정 폴더와 디지털 비트가 예상대로 작동함을 나타냅니다.

발행
IEICE TRANSACTIONS on Electronics Vol.E92-C No.8 pp.1073-1079
발행일
2009/08/01
공개일
온라인 ISSN
1745-1353
DOI
10.1587/transele.E92.C.1073
원고의 종류
PAPER
범주
전자 회로

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