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DRAM Controller with a Complete Predictor 완전한 예측기를 갖춘 DRAM 컨트롤러

Vladimir V. STANKOVIC, Nebojsa Z. MILENKOVIC

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요약 :

컴퓨터 메모리 시스템 성능 향상을 위한 리소스 무기고에서 지난 몇 년간 예측 변수의 역할이 점점 더 커지고 있습니다. 캐시나 주 메모리에 액세스할 때 대기 시간을 억제할 수 있습니다. 논문 [1]에서는 라이브 타임, 데드 타임, 액세스 간격으로 정의된 캐시 메모리 액세스의 시간 매개변수가 데이터 프리페칭 예측에 어떻게 사용될 수 있는지 보여줍니다. 본 논문에서는 다양한 개선을 통해 DRAM 메모리 행의 열기/닫기 제어에 아날로그 기술을 적용하는 타당성을 조사합니다. 여기에 설명된 결과는 타당성을 확인하고 열려 있는 DRAM 행을 닫을 뿐만 아니라 다음 열이 열리는 행을 예측하는 예측기를 갖춘 DRAM 컨트롤러를 제안할 수 있게 해줍니다.

발행
IEICE TRANSACTIONS on Information Vol.E92-D No.4 pp.584-593
발행일
2009/04/01
공개일
온라인 ISSN
1745-1361
DOI
10.1587/transinf.E92.D.584
원고의 종류
PAPER
범주
컴퓨터 시스템

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